欢迎来挑战分频

xuewuhen2015

欢迎来挑战分频 [复制链接]

想要实现从50M到65536，怎样才能实现的更好，更稳定

ganyong0721

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--程序名：任意整数分频，占空比为50%
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library ieee;
use ieee.std_logic_1164.all;
entity clk_div1k is
generic(n:integer:=50000);--n的值是要分频的系数，n>=2
    port (clock : in std_logic:='0';
          clk_out : out std_logic);
end clk_div1k;
architecture one of clk_div1k is
signal temp : std_logic:='0';
begin
process(clock,temp)
variable a,a1,a2 : integer range 0 to n;
variable temp1,temp2 : std_logic:='0';
begin
--------------------------------------------
if (n rem 2)=1 then
if rising_edge(clock) then
    if a1=n-1 then a1:=0;temp1:='0';
    elsif a1<((n+1)/2-1) then temp1:='1';a1:=a1+1;
       elsif a1>=((n+1)/2-1) then temp1:='0';a1:=a1+1;
    end if;
end if;
if falling_edge(clock) then
    if a2=n-1 then a2:=0;temp2:='0';
    elsif a2<((n+1)/2-1) then temp2:='1';a2:=a1+1;
       elsif a2>=((n+1)/2-1) then temp2:='0';a2:=a2+1;
    end if;
end if;
temp<=temp1 or temp2;
---------------------------------------------
elsif rising_edge(clock) then
    if a=(n/2-1) then a:=0;temp<=not temp;
    else a:=a+1;
    end if;
end if;
end process;
clk_out<=temp;
end one;
你看一下，你改N的值可以大致达到。

eeleader

楼主的VDHL语言表达方式感觉对硬件电路理解不深！