电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › verilog的一个语法问题

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一粒金砂（中级）

楼主

发表于2012-4-26 20:50 只看该作者

verilog的一个语法问题 [复制链接]

verilog中，一个always中如果含有好几个case语句，那么这些case语句是并发执行，还是顺序执行呢？？如下

always

begin

case(a)

…………

case(b)

…………

case(c)

…………

end

always

此帖出自FPGA/CPLD论坛

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eeleader

顺序执行！详情回复发表于 2012-4-26 21:33

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eeleader

6892 帖子	0 TA的资源

五彩晶圆（高级）

沙发

发表于2012-4-26 21:33 只看该作者

顺序执行！

此帖出自FPGA/CPLD论坛

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