电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › MAX10 脚位串扰

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一粒金砂（初级）

楼主

发表于2021-1-25 15:21 只看该作者

MAX10 脚位串扰 [复制链接]

请问我写了一个计频率的

只有接一个侧频的脚位

频率计数正常

但我又接另一个脚位上去此脚位是另一个频率

此时计频数就乱跳

我用SignalTap 看

被测信号有被干扰

拔掉另外一根线就正常

不晓是什问题

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okhxyyo

你应该把你的电路图或者代码发上来，这样子我们看不出来哪里出错详情回复发表于 2021-1-26 09:14

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okhxyyo

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管理员

沙发

发表于2021-1-26 09:14 只看该作者

你应该把你的电路图或者代码发上来，这样子我们看不出来哪里出错

此帖出自FPGA/CPLD论坛


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ecfun99

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一粒金砂（初级）

板凳

楼主| 发表于2021-2-10 14:55 只看该作者

我用 singTapII 看閘門信號有毛邊

一個閘門信號被干擾

我是用飛線

打算LAYOUT PCB 測試

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