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电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › 求助，关于xilinx分频

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一粒金砂（中级）

发表于2017-10-16 11:47 最新更新于2017-10-17 14:19 显示全部楼层

求助，关于xilinx分频 [复制链接]

菜鸟求助，以前没用过xilinx，现在想用PLL把50M的系统时钟，分频成48M，不知道怎么写，求大神帮忙

此帖出自FPGA/CPLD论坛

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682 帖子	108 资源

纯净的硅（中级）

发表于2017-10-17 11:12 显示全部楼层

也没用过xilinx FPGA，但一般带PLL的FPGA，分频系数和倍频系数都有个范围的。
50M 变 48M，需要25分频，再24倍频，那么唯一要确定的是，分频和倍频系数最大值能不能等于25、24。

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谢谢详情回复发表于 2017-10-17 14:19

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一粒金砂（中级）

楼主| 发表于2017-10-17 14:19 显示全部楼层

gs001588 发表于 2017-10-17 11:12
也没用过xilinx FPGA，但一般带PLL的FPGA，分频系数和倍频系数都有个范围的。
50M 变 48M，需要25分频，再 ...

谢谢

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