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查看: 855|回复: 2

[求助] 关于数字滤波器的设计

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一粒金砂(中级)

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发表于 2017-1-11 17:22:15 | 显示全部楼层 |阅读模式
各位前辈,我想设计一个低通滤波器,就输入的码元速率是50bps,然后我之前设计了一个,采样率为2k,也就是一个码元采了40个点,然后效果不好,滤波出来有很多其他的分量,我就想问一下,熟悉数字低通滤波器的,这个滤波器的设计,对于采样率有什么要求没有,是不是不能太低了?
此帖出自FPGA/CPLD论坛


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一粒金砂(中级)

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 楼主| 发表于 2017-1-11 17:22:38 | 显示全部楼层
,谢谢各位了


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一粒金砂(中级)

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发表于 2017-1-11 18:50:07 | 显示全部楼层
要符合奈奎斯特采样定理!!!!你可以分析一下那些你不需要的频谱,是不是在镜像上,具体细节我也有点想不起来了。。。
以前做滤波器是用matlab里的fdatool设计滤波器!!!你可以了解一下!


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