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[讨论] Cyclone V 器件DDR的 oct_rzqin管脚如果没有接100欧姆电阻,会影响DDR工作吗?

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一粒金砂(中级)

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发表于 2016-2-26 16:27:44 | 显示全部楼层 |阅读模式
        最近在用CycloneV  FPGA调试DDR3,画板子的时候没有注意到这个oct_rzqin管脚,该管脚处于悬空的状态,我看handbook中写道这个管脚应该接一个100欧姆的电阻到地,我现在没有接,不知道会不会影响到DDR3的工作。
         使用上面的电路板,例化软核DDR可以使用,但是例化硬核时,DDR信号中的local_cal_fial为高,local_cal_success为低电平,不知道是不是这个管脚的影响?
        麻烦知道的大神指点一二。
此帖出自FPGA/CPLD论坛


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技术导师勋章

发表于 2016-2-27 00:59:35 | 显示全部楼层
有没有问题以及是什么问题,弄清楚该管脚的功能定义即可获知,手册里一定有讲。
上传了一些书籍资料,也许有你想要的:http://download.eeworld.com.cn/user/chunyang


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技术导师勋章

发表于 2016-2-26 16:35:49 | 显示全部楼层
手册中注明要加那就必须加。可以用带引脚型电阻搭焊。

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FPGA的这个管脚没有没有引出来,还怎么焊? 另外,如果是这个管脚的影响,那用软核的时候是没有问题的,这个怎么解释呢?谢谢了  详情 回复 发表于 2016-2-26 16:52
上传了一些书籍资料,也许有你想要的:http://download.eeworld.com.cn/user/chunyang


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 楼主| 发表于 2016-2-26 16:52:09 | 显示全部楼层
chunyang 发表于 2016-2-26 16:35
手册中注明要加那就必须加。可以用带引脚型电阻搭焊。

FPGA的这个管脚没有没有引出来,还怎么焊?

另外,如果是这个管脚的影响,那用软核的时候是没有问题的,这个怎么解释呢?谢谢了

点评

如果是BGA封装就没办法了。  详情 回复 发表于 2016-2-27 00:58


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发表于 2016-2-27 00:58:29 | 显示全部楼层
bysg312 发表于 2016-2-26 16:52
FPGA的这个管脚没有没有引出来,还怎么焊?

另外,如果是这个管脚的影响,那用软核的时候是没有问题的 ...

如果是BGA封装就没办法了。
上传了一些书籍资料,也许有你想要的:http://download.eeworld.com.cn/user/chunyang


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一粒金砂(中级)

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发表于 2018-10-8 10:52:55 | 显示全部楼层
目前解决了吗?这个怎么处理呢?


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一粒金砂(中级)

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发表于 2018-10-9 00:31:52 | 显示全部楼层
不知道这个oct_rzqin是输入还是输出引脚,  输出问题不大, 输入就问题大了.


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一粒金砂(中级)

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发表于 2018-10-9 00:32:58 | 显示全部楼层
能飞线还好,  飞一下解决,  不能飞只能修改设计.


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