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[求助] FPGA DSP 通信,用EMIF接口

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一粒金砂(中级)

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发表于 2013-5-28 09:02:12 | 显示全部楼层 |阅读模式
请问有人做过FPGA与DSP通信吗?用EMIF接口,在FPGA上我用的是内部fifo,那些fifo的接口与DSP的引脚该怎么连呀?我现在的结果是感觉接受不同步
此帖出自FPGA/CPLD论坛


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五彩晶圆(高级)

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发表于 2013-5-28 21:13:16 | 显示全部楼层
当然要用RAM缓冲

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请问是只能用RAM 吗?fifo可以吗?  详情 回复 发表于 2013-5-29 08:59
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一粒金砂(中级)

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 楼主| 发表于 2013-5-29 08:57:14 | 显示全部楼层

FPGA DSP 通信,用EMIF接口

请问是只能用双口RAM吗?用FIFO 可以吗?


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一粒金砂(中级)

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 楼主| 发表于 2013-5-29 08:59:49 | 显示全部楼层

回复 沙发 eeleader 的帖子

请问是只能用RAM 吗?fifo可以吗?


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五彩晶圆(高级)

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发表于 2013-5-29 11:08:19 | 显示全部楼层
F1F0也可以,不过操作RAM更简单。与DSP
相连的接口就总线信号,没有别的

点评

应该还得有ARE,AOE,CE等这些控制信号呢吧?要不然他们以什么方式传呢?  详情 回复 发表于 2013-6-24 15:22
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一粒金砂(中级)

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 楼主| 发表于 2013-6-24 15:22:57 | 显示全部楼层

回复 5楼eeleader 的帖子

应该还得有ARE,AOE,CE等这些控制信号呢吧?要不然他们以什么方式传呢?


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