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[求助] FPGA死机

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发表于 2013-5-27 16:10:23 | 显示全部楼层 |阅读模式
自从昨天把采样频率倍频到200M后,就出现死机问题。谁知道这是什么原因引起的啊?电源问题吗?
此帖出自FPGA/CPLD论坛


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技术导师勋章

发表于 2013-5-27 21:27:02 | 显示全部楼层
任何器件都有工作频率的限制,不能超出,同时,FPGA的内逻辑设计也会影响到最高工作频率,设计不合适的话会明显降低最高工作频率。

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FPGA选的EP2C8Q208C8,200M应该没问题啊  详情 回复 发表于 2013-5-28 08:41
上传了一些书籍资料,也许有你想要的:http://download.eeworld.com.cn/user/chunyang


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 楼主| 发表于 2013-5-28 08:41:46 | 显示全部楼层

回复 沙发 chunyang 的帖子

FPGA选的EP2C8Q208C8,200M应该没问题啊


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五彩晶圆(高级)

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发表于 2013-5-28 21:19:17 | 显示全部楼层
这个芯片200MHz有点吃力。

点评

设置PLL的时候可选选项到1G啊,这是Quartus支持的芯片里面最高的吗?  详情 回复 发表于 2013-5-28 21:51
一个为理想不懈前进的人,一个永不言败人!
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 楼主| 发表于 2013-5-28 21:51:15 | 显示全部楼层

回复 4楼 eeleader 的帖子

设置PLL的时候可选选项到1G啊,这是Quartus支持的芯片里面最高的吗?


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五彩晶圆(高级)

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发表于 2013-5-29 10:57:37 | 显示全部楼层
这是高速接口的时钟,比如lvds
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五彩晶圆(高级)

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发表于 2013-5-29 11:17:06 | 显示全部楼层
出现死机问题,99%是电源问题。频

越大,电源完整性要求越高。
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五彩晶圆(初级)

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荣誉会员勋章

发表于 2013-5-30 19:51:48 | 显示全部楼层
也有可能时序问题,2C8逻辑大跑200M不容易,那些时钟指标都是独立内部资源的指标的,系统设计会下降很多。


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一粒金砂(中级)

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发表于 2013-6-6 21:50:00 | 显示全部楼层
要是我,会用示波器测量电源,如果毛刺多的话就是电源品质不好了,这种情况很有可能,我曾经用过的2812DSP也是锁相环无法倍频到最高速,滤一下内核电压就好了


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