电子工程世界-论坛»论坛 › 电子技术交流 › FPGA/CPLD › EE_FPGA学习乐园 › 编译好慢

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一粒金砂（中级）

发表于2023-8-1 15:20 最新更新于2023-08-01 15:20 显示全部楼层

编译好慢 [复制链接]

本人刚刚上手fpga

轻薄本低压芯片编译

一个100行的代码从RTL到bitstream都要1min

想问问大家，那大型项目怎么办，

如何快速调试

还是说调试的大部分工作交给仿真？

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观赏桃

windows下综合时间取决于你的CPU主频详情回复发表于 2023-8-29 09:30

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秦天qintian0303

3263 帖子	1 TA的资源

版主

发表于2023-8-1 16:29 显示全部楼层

大型项目的程序都会分模块开发的，调试也是各自调试

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wangerxian

4236 帖子	0 TA的资源

版主

发表于2023-8-1 16:51 显示全部楼层

FPGA好像编译就是非常慢的，建议换电脑编译学习。

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bigbat

2479 帖子	2 TA的资源

五彩晶圆（中级）

发表于2023-8-1 17:26 显示全部楼层

这个和你的需要综合的语句有关，但是fpga就是非常慢，所以要分模块开发。

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吾妻思萌

2984 帖子	8 TA的资源

版主

发表于2023-8-1 17:33 来自手机显示全部楼层

多线程吗？

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观赏桃

9 帖子	0 TA的资源

一粒金砂（中级）

发表于2023-8-29 09:30 显示全部楼层

windows下综合时间取决于你的CPU主频

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