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chenbingjy

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纯净的硅（高级）
发表于2023-4-15 17:34 最新更新于2023-05-17 18:53 显示全部楼层

用Verilog如何给数组赋值 [复制链接]

我这样写的
reg [7:0] mema [0:3] = {8'h55,8'haa,8'h5a,8'ha5};
可是编译出错：

7.jpg

请问高手，怎么解决呀？谢谢！

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chenbingjy
谢谢   详情 回复 发表于 2023-4-20 10:32
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Jacktang

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五彩晶圆（中级）
发表于2023-4-16 09:33 显示全部楼层

编译出错

 或是mema [0:3] 本身有问题

或是因为对解包数组的赋值必须是聚合表达式的式有问题

仅供参考

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led2015

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TA的资源

版主
发表于2023-4-16 22:34 显示全部楼层

可能是因为 Verilog 中的数组初始化必须在 module 语句之外进行

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chenbingjy

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纯净的硅（高级）
 楼主| 发表于2023-4-17 09:20 显示全部楼层

还是没搞定

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苦茶子

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一粒金砂（初级）
发表于2023-4-17 10:36 显示全部楼层
声明的时候不能直接赋值的，即使可以编译的时候也会忽略。解决办法是在always块内用for循环赋值。
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chenbingjy
for循环赋值不好吧。如果数据没有规律，不好实现  详情 回复 发表于 2023-4-18 10:22

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chenbingjy

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纯净的硅（高级）
 楼主| 发表于2023-4-18 10:22 显示全部楼层
苦茶子 发表于 2023-4-17 10:36 声明的时候不能直接赋值的，即使可以编译的时候也会忽略。解决办法是在always块内用for循环赋值。

for循环赋值不好吧。如果数据没有规律，不好实现

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苦茶子

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一粒金砂（初级）
发表于2023-4-20 09:27 显示全部楼层

那只能一个一个赋值，或者你用rom

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chenbingjy
谢谢  详情 回复 发表于 2023-4-20 10:32

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chenbingjy

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纯净的硅（高级）
 楼主| 发表于2023-4-20 10:32 显示全部楼层
苦茶子 发表于 2023-4-20 09:27 那只能一个一个赋值，或者你用rom

谢谢

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