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[求助] 请教如何用逻辑电路产生这样的时序

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发表于 2019-5-15 20:34 | 显示全部楼层 |阅读模式

如下图,A,B为输入,C为输出,
在B产生一个高电平后,C在A的上升沿输出高电平
C在B的上升沿输出低电平
如果B维持低电平无论A怎么变化,C始终输出低电平


`N5YC3P7LE5_%CPH%I)R86I.png
此帖出自FPGA/CPLD论坛
虾扯蛋


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 楼主| 发表于 2019-5-16 05:46 | 显示全部楼层

自己解决了
B为0时无论A怎么变化C都为0
B为上升沿时左边的触发器输出1,右边的触发器复位,C从1变为0或者维持0
此时A上升沿时C输出1,与门2个输入为1时输出1,左边的触发器复位并输出0
此时与门输出0,左边触发器结束复位


QQ图片20190516054019.png
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发表于 2019-5-15 20:58 | 显示全部楼层
这可难了,用单片机吧

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自己画出来了 在五楼  详情 回复 发表于 2019-5-16 09:39
用单片机不行啊  详情 回复 发表于 2019-5-15 21:34
http://shop34182318.taobao.com/
https://shop436095304.taobao.com/?spm=a230r.7195193.1997079397.37.69fe60dfT705yr


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 楼主| 发表于 2019-5-15 21:34 | 显示全部楼层
ddllxxrr 发表于 2019-5-15 20:58
这可难了,用单片机吧

用单片机不行啊
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一粒金砂(高级)

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发表于 2019-5-15 23:44 来自手机 | 显示全部楼层
感觉挺简单的,需要帮助就私聊我

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自己画出来了 在五楼  详情 回复 发表于 2019-5-16 09:39


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maychang

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发表于 2019-5-16 07:21 | 显示全部楼层
“如果B维持低电平无论A怎么变化,C始终输出低电平” 203011.jpg
你的波形图中画红色框处是否与上面那句话矛盾?

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5楼 老大帮忙看下有没有问题  详情 回复 发表于 2019-5-16 09:40
这句话是我表达有问题 C如果想输出高电平B必需要有一个脉冲后才行 “如果B维持低电平“的意思是B从来没有产生过脉冲 昨天想一晚上自己画了一个电路早上验证了一下应该是能够实现这个功能了 回贴需要审核,还没  详情 回复 发表于 2019-5-16 08:11


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 楼主| 发表于 2019-5-16 08:11 | 显示全部楼层
maychang 发表于 2019-5-16 07:21
“如果B维持低电平无论A怎么变化,C始终输出低电平”
你的波形图中画红色框处是否与上面那句话矛盾?

这句话是我表达有问题
C如果想输出高电平B必需要有一个脉冲后才行
“如果B维持低电平“的意思是B从来没有产生过脉冲

昨天想一晚上自己画了一个电路早上验证了一下应该是能够实现这个功能了
回贴需要审核,还没有通过。
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裸片初长成(初级)

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发表于 2019-5-16 08:53 | 显示全部楼层
从图上看A B为低时,C变高,A低,B高时,C为低。你这样分析一下,然后将所有过程都罗列一下,应该就没问题。
请修改签名 ^_^


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裸片初长成(初级)

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发表于 2019-5-16 08:54 | 显示全部楼层
如果是组合逻辑,我觉得比较难,但是如果是时序逻辑,加一个clk就好办多了

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自己画出来了 在五楼  详情 回复 发表于 2019-5-16 09:40
请修改签名 ^_^


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 楼主| 发表于 2019-5-16 09:39 来自手机 | 显示全部楼层
ddllxxrr 发表于 2019-5-15 20:58
这可难了,用单片机吧

自己画出来了 在五楼


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 楼主| 发表于 2019-5-16 09:39 来自手机 | 显示全部楼层
不足论 发表于 2019-5-15 23:44
感觉挺简单的,需要帮助就私聊我

自己画出来了 在五楼

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我都不怎么看这种图的。。。太底层了 我以为是需要硬件描述语言呢  详情 回复 发表于 2019-5-16 10:31


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 楼主| 发表于 2019-5-16 09:40 来自手机 | 显示全部楼层
maychang 发表于 2019-5-16 07:21
“如果B维持低电平无论A怎么变化,C始终输出低电平”
你的波形图中画红色框处是否与上面那句话矛盾?

5楼 老大帮忙看下有没有问题

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5楼 老大帮忙看下有没有问题 5楼是 不足论 网友的回复,未见图片。 2楼倒是有电路图片,但方框中未标注芯片型号。未标注型号,我不知道真值表,没办法说。  详情 回复 发表于 2019-5-16 10:03


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 楼主| 发表于 2019-5-16 09:40 来自手机 | 显示全部楼层
heningbo 发表于 2019-5-16 08:54
如果是组合逻辑,我觉得比较难,但是如果是时序逻辑,加一个clk就好办多了

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maychang

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发表于 2019-5-16 10:03 | 显示全部楼层
littleshrimp 发表于 2019-5-16 09:40
5楼 老大帮忙看下有没有问题

5楼 老大帮忙看下有没有问题

5楼是 不足论 网友的回复,未见图片。
2楼倒是有电路图片,但方框中未标注芯片型号。未标注型号,我不知道真值表,没办法说。

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置顶以后变成2楼了  详情 回复 发表于 2019-5-16 10:06


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 楼主| 发表于 2019-5-16 10:06 | 显示全部楼层
maychang 发表于 2019-5-16 10:03
5楼 老大帮忙看下有没有问题

5楼是 不足论 网友的回复,未见图片。
2楼倒是有电路图片,但方框中未标 ...

置顶以后变成2楼了

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“置顶以后变成2楼了” 变成2楼,我还是不知道那是什么触发器。我只能知道d和q是两个输出端,clk是时钟(上升沿触发还是下降沿触发仍然不知道),ar是什么也不知道(只知道这是个输入端)。  详情 回复 发表于 2019-5-16 10:36
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一粒金砂(高级)

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发表于 2019-5-16 10:31 来自手机 | 显示全部楼层
littleshrimp 发表于 2019-5-16 09:39
自己画出来了 在五楼

我都不怎么看这种图的。。。太底层了
我以为是需要硬件描述语言呢

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原理一样的 能实现就成  详情 回复 发表于 2019-5-16 10:59


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maychang

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发表于 2019-5-16 10:36 | 显示全部楼层
littleshrimp 发表于 2019-5-16 10:06
置顶以后变成2楼了

“置顶以后变成2楼了”

变成2楼,我还是不知道那是什么触发器。我只能知道d和q是两个输出端,clk是时钟(上升沿触发还是下降沿触发仍然不知道),ar是什么也不知道(只知道这是个输入端)。

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d触发器 d输入 clk时钟 q输出 ar异步复位(高电平有效)  详情 回复 发表于 2019-5-16 10:59


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 楼主| 发表于 2019-5-16 10:59 来自手机 | 显示全部楼层
maychang 发表于 2019-5-16 10:36
“置顶以后变成2楼了”

变成2楼,我还是不知道那是什么触发器。我只能知道d和q是两个输出端,clk是时 ...

d触发器
d输入 clk时钟 q输出 ar异步复位(高电平有效)

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ar异步复位(高电平有效) 好像没有哪种D触发器芯片是高电平有效复位的。74HC74是双D触发器,但复位是低电平有效。  详情 回复 发表于 2019-5-16 11:30


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 楼主| 发表于 2019-5-16 10:59 来自手机 | 显示全部楼层
不足论 发表于 2019-5-16 10:31
我都不怎么看这种图的。。。太底层了
我以为是需要硬件描述语言呢

原理一样的 能实现就成

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嗯,逻辑简单点可以这么弄  详情 回复 发表于 2019-5-16 11:02


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发表于 2019-5-16 11:02 来自手机 | 显示全部楼层
littleshrimp 发表于 2019-5-16 10:59
原理一样的 能实现就成

嗯,逻辑简单点可以这么弄

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开始准备用Look-Up-Table弄了,昨晚想想触发器可以就用触发器了,这样电路里可以不使用CPLD。  详情 回复 发表于 2019-5-16 11:20


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