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预览 [求助] DS18B20温度值处理的VHDL程序请教 @【FPGA/CPLD】 日出东方 2018-4-12 32515 日出东方 2018-4-20 08:33
预览 [求助] verilog程序仿真的问题 @【FPGA/CPLD】 attach_img chenbingjy 2018-3-28 51071 chenbingjy 2018-4-15 19:20
预览 【转】Altera SoC的Linux内核编译方法 @【Altera SoC】 attachment chenzhufly 2015-1-19 1910758 douser2676 2018-4-14 23:25
预览 求助:为什么 核1启动不了 @【Altera SoC】 attach_img zxy7895123 2018-4-13 1821 zxy7895123 2018-4-13 15:49
预览 DS 5连接出错,提示unable to connect to TCP:localhost,会是什么原因? @【Altera SoC】 attach_img hl9527 2017-8-23 52331 钱小玮 2018-4-11 23:30
预览 [原创] FPGA TCP/UDP千兆以太网高速传输, 开源UDP版工程 @【FPGA/CPLD】 attach_img heatlevel  ...2 chat1 2016-3-8 347379 shortfordalong 2018-4-11 14:00
预览 正版DS-5连接SOCFPGA报错!!! @【Altera SoC】 attach_img yupc123 2016-1-19 112538 jenna_xu 2018-4-11 11:37
预览 新手求助:关于socfpga的preload和uboot @【Altera SoC】 douser2676 2018-4-10 0919 douser2676 2018-4-10 23:59
预览 写测试文件步骤 @【EE_FPGA学习乐园】 大辉哥0614 2018-4-10 11002 大辉哥0614 2018-4-10 12:18
预览 FFT IP核控制,数据输入正常,但是sink_ready不拉高,数据也没有输出,下图是测试图 @【EE_FPGA学习乐园】 szlddn 2017-12-13 91525 wyz1234 2018-4-9 11:17
预览 [求助] 请大神帮看看 @【FPGA/CPLD】 attach_img 火影星飞 2018-4-8 2901 火影星飞 2018-4-8 20:30
预览 [求助] 100BASE-X PCS/PMA OR SGMII IP 的resetdone 信号时高时低的不稳定 @【FPGA/CPLD】 李大家 2018-4-8 0821 李大家 2018-4-8 10:06
预览 [求助] FFT IP 核不出数据,有蓝线,是因为状态机写的不正确? @【FPGA/CPLD】 attach_img VIP那么遥远 2018-4-7 1762 爱阑珊智能 2018-4-8 09:59
预览 [求助] 用verilog HDL设计的4x4键盘扫描程序的testbench怎么写 @【FPGA/CPLD】 attach_img 火影星飞 2018-4-7 61138 火影星飞 2018-4-7 18:45
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预览 如何利用FPGA进行时序分析设计 @【EE_FPGA学习乐园】 大辉哥0614 2018-4-3 1950 大辉哥0614 2018-4-3 11:19
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