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FPGA/CPLD 今日: 1 |主题: 9066

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隐藏置顶帖 预览 模电怎么学?TI帮你订制课程清单,体验“模电选课测试”功能,赢精彩好礼和积分! @【大学堂专版】 attach_img EE大学堂 2019-4-10 41750 ymz007 3 天前
隐藏置顶帖 预览 阅读瑞萨电子电源模块系列白皮书,赢双重好礼:提升能量有礼&推荐100%有礼 ! @【瑞萨电子MCU】 EEWORLD社区 2019-4-4 22031 dfwisdom 4 天前
隐藏置顶帖 预览 报名即将结束|兆易创新 GD32E231 DIY 大赛!100套开发板免费尝鲜+重磅豪礼! @【GD32 MCU】 EEWORLD社区 2019-3-27 73006 hujj 2019-4-2 08:05
全局置顶 隐藏置顶帖 预览 EEWORLD社区积分制度、新手提问前必读(快速得到答案秘籍)!!! @【为我们提建议&公告】 attachment  ...23456..138 EEW 2008-10-14 27511295793 捷多邦方先生 3 天前
全局置顶 隐藏置顶帖 预览 EEworld版主招新啦!!欢迎加入我们的队伍!!! @【为我们提建议&公告】 okhxyyo 2018-5-3 1218285 捷多邦方先生 3 天前
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预览 [求助] Verilog多个模块怎么整合到一块,然后通过下载线下载到FPGA里边呢,谢谢 @【FPGA/CPLD】 attach_img luoqingqun 2014-5-10 1015156 南风瑾 6 小时前
预览 [原创] 芯航线FPGA教程手册V1.09。小梅哥文集。主要介绍开发中的各种经验和操作,适合作为... @【FPGA/CPLD】 attachment heatlevel  ...2 小梅哥 2016-3-24 383686 malaxiaolongxia 昨天 15:44
预览 verilog中怎么实现对两个部分代码的判断执行 @【EE_FPGA学习乐园】 New _驿北 昨天 10:37 0130 _驿北 昨天 10:37
预览 [求助] 求个vhdl写的eeprom读写,掉电数据不丢失功能 @【FPGA/CPLD】 New 刘123 3 天前 1110 fxyc87 昨天 08:36
预览 Cyclone V官方中文数据手册集合 @【Altera SoC】 attachment heatlevel  ...23456..8 e小强2013 2015-11-29 14121677 feitian888 前天 17:40
预览 [Altera] nios数据传输问题 @【FPGA/CPLD】 New yym86202 前天 08:39 0112 yym86202 前天 08:39
预览 [求助] quartus 13.0为什么输出波形一直为低电平? @【FPGA/CPLD】 attach_img 鼻涕兽 2019-4-7 13231 鼻涕兽 4 天前
预览 [求助] 有嵌入式C编程基础,数电几乎为零,自学fpga到以太网通信要多久? @【FPGA/CPLD】 New yxdbc2008 5 天前 2148 heningbo 4 天前
预览 ISE中的IP核问题 @【尤老师专栏】 New Domipy 5 天前 1152 郝旭帅 4 天前
预览 [讨论] FPGA按键问题 @【FPGA/CPLD】 attach_img sudongpo2018 2019-4-11 3164 郝旭帅 6 天前
预览 [求助] 使用modelsim卡住的问题 @【FPGA/CPLD】 谷怂怂 2019-4-12 1162 郝旭帅 6 天前
预览 基于FPGA+PWM多路信号发生器的设计 @【Altera SoC】 贤贤贤贤 2019-4-12 7442 郝旭帅 6 天前
预览 [求助] quartusII.dpf格式4位共阴数码管显示0~9999 @【FPGA/CPLD】 李延哲 2016-6-1 12077 wqywc123 2019-4-12 15:12
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预览 【FPGA入门到实战】手把手讲解异步FIFO内部原理2; 源码&答疑 @【尤老师专栏】 attachment 尤老师 2016-8-26 47688 zhangjunke08 2019-4-9 22:37
预览 [求助] vivado2018.1的fifo问题 @【FPGA/CPLD】 attachment dreamandactual 2019-3-30 4269 dreamandactual 2019-4-9 14:53
悬赏 预览 请问如何用verilog实现一个迭代方程呀? @【EE_FPGA学习乐园】 - [悬赏 1 枚芯币] kinglihongyu 2019-2-28 9466 heningbo 2019-4-8 09:03
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预览 ddr3初始化失败 @【Altera SoC】 attach_img flying~ 2018-10-17 61368 chengxiuyuan 2019-4-3 10:11
预览 [Xilinx] Xilinx 12.4 和modelsim联合仿真,总是出现这样的错误是什么原因? @【FPGA/CPLD】 Luuu0324 2019-3-9 1266 phdwong 2019-4-1 23:45
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